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professional软件中的译码器在 软件professional

【2021-08-25 08:46:38】 来源:网络 作者:福州电脑之家 评论:

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没背光,0x4f,0x66。

AND 与门ANTENNA 天线BATTERY 直流电源BELL 铃,钟BVC 同轴电缆接插件BRIDEG 1 整流桥(二极管)BRIDEG 2 整流桥(集成块)BUFFER 缓冲器BUZZER 蜂鸣器CAP 电容CAPACITOR 电容CAPACITOR POL 有极性电容CAPVAR 可调电容CIRCUIT BREAKER 熔断丝COAX 同轴电缆CON 插口CRYSTAL 晶体整荡器DB 并行插口DIODE 二极管DIODE SCHOTTKY 稳压二极管DIODE VARACTOR 变容二极管DPY_3-SEG 3段LEDDPY_7-SEG 7段LEDDPY_7-SEG_DP 7段LED(带小数点)ELECTRO 电解电容FUSE 熔断...

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目录1 设计目的 32 设计要求指标 32.1 基本功能 32.2 扩展功能 43.方案论证与比较 44 总体框图设计 45 电路原理分析 45.1数字钟的构成 45.1.1 分频器电路 55.1.2 时间计数器电路 55.1.3分频器电路 65.1.4振荡器电路 65.1.5数字时钟的计数显示电路 65.2 校时电路 75.3 整点报时电路 86系统仿真与调试 87.结论 8 参考文献 9 实验作品附图 10 数字钟 摘要:数字钟是一种用数字电路技术实现时、分、秒计时的装置,与机械式时钟相比具有更高的准确性和直观性,且无机械装置,具有更更长的使用寿命,因此得到了广泛的使用。

数字钟从原理上讲是一种典型的数字电路,其中包括了组合逻辑电路和时序电路。

目前,数字钟的功能越来越强,并且有多种专门的大规模集成电路可供选择。

从有利于学习的角度考虑,这里主要介绍以中小规模集成电路设计数字钟的方法。

经过了数字电路设计这门课程的系统学习,特别经过了关于组合逻辑电路与时序逻辑电路部分的学习,我们已经具备了设计小规模集成电路的能力,借由本次设计的机会,充分将所学的知识运用到实际中去。

本次课程设计要求设计一个数字钟,基本要求为数字钟的时间周期为24小时,数字钟显示时、分、秒,数字钟的时间基准一秒对应现实生活中的时钟的一秒。

供扩展的方面涉及到定时自动报警、按时自动打铃、定时广播、定时启闭路灯等。

因此,研究数字钟及扩大其应用,有着非常现实的意义。

1 设计目的1.掌握数字钟的设计、组装与调试方法。

2.熟悉集成元器件的选择和集成电路芯片的逻辑功能及使用方法。

3.掌握面包板结构及其接线方法4.熟悉仿真软件的使用。

2 设计要求及指标2.1基本功能1)时钟显示功能,能够正确显示“时”、“分”、“秒”。

2)具有快速校准时、分、秒的功能。

3)用555定时器与RC组成的多谐振荡器产生一个标准频率(1Hz)的方波脉冲信号。

2.2扩展功能1)用晶体振荡器产生一个标准频率(1Hz)的脉冲信号。

2)具有整点报时的功能。

3)具有闹钟的功能。

4)……3、方案论证与比较 本设计方案使用555多谐振荡器来产生1HZ的信号。

通过改变相应的电阻电容值可使频率微调,不必使用分频器来对高频信号进行分频使电路繁复。

虽然此振荡器没有石英晶体稳定度和精确性高,由于设计方便,操作简单,成为了设计时的首选,但是由于与实验中使用的555芯片产生的脉冲相比较,利用晶振产生的脉冲信号更加的稳定,同过电压表的测量能很好的观察到这一点,同时在显示上能够更加接进预定的值,受外界环境的干扰较少,一定程度上优于使用555芯片产生信号方式。

我们组依然同时设计了555和晶振两个信号产生电路。

(本实验报告中着重按照原方案设计的555电路进行说明)4、 系统设计框图 数字式计时器一般由振荡器、分频器、计数器、译码器、显示器等几部分组成。

在本设计中555振荡器及其相应外部电路组成标准秒信号发生器,由不同进制的计数器、译码器和显示器组成计时系统。

秒信号送入计数器进行计数,把累计的结果以‘时’、‘分’、‘秒’的数字显示出来。

‘时’显示由二十四进制计数器、译码器、显示器构成,‘分’、‘秒’显示分别由六十进制计数器、译码器、显示器构成。

其原理框图如图1.1所示。

5、电路原理分析5.1数字钟的构成 数字钟实际上是一个对标准频率(1HZ)进行计数的计数电路.由于计数的起始时间不可能与标准时间一致,故需要在电路上加一个校时电路,同时标准的1HZ时间信号必须做到准确稳定.在此使用555振荡器组成1Hz的信号。

数字钟原理框图(1.1)5.1.1振荡器电路 555定时器组成的振荡器电路给数字钟提供一个频率为1Hz的方波信号。

其中OUT为输出。

5.1.2时间计数器电路 时间计数电路由秒个位和秒十位计数器,分个位和分十位计数器及时个位和时十位计数器电路构成,其中秒个位和秒十位计数器、分个位和分十位计数器为60进制计数器,而根据设计要求,时个位和时十位计数器为24进制计数器. 5.1.3分频器电路 通常,数字钟的晶体振荡器输出频率较高,为了得到1Hz的秒信号输入,需要对振荡器的输出信号进行分频。

通常实现分频器的电路是计数器电路,一般采用多级2进制计数器来实现。

例如,将32768Hz的振荡信号分频为1HZ的分频倍数为32768( ),即实现该分频功能的计数器相当于15级2进制计数器。

5.1.4振荡器电路 利用555定时器组成的多谐振荡器接通电源后,电容C1被充电,当电压上升到一定数值时里面集成的三极管导通,然后通过电阻和三极管放电,不断的充放电从而产生一定周期的脉冲,通过改变电路上器件的值可以微调脉冲周期。

5.1.5数字时钟的计数显示控制 在设计中,我们使用的是74**160十进制计数器,来实现计数的功能,实验中主要用到了160的置数清零功能(特点:消耗一个时钟脉冲),清零功能(特点:不耗时钟脉冲),在上级160控制下级160时候通过组合电路(主要利用与非门)实现,在连接电路的时候要注意并且强调使能端的连接,其将影响到整一个电路的是否工作。

电路的控制原理如下:秒钟由个位向十位进位:0000—0001—0010—0011—0100—0101—0110—0111—1000—1001实...

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